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Embedded Systems Specification and Design Languages: Selected contributions from FDL’07
Springer Netherlands
Jens Brandt
,
Klaus Schneider (auth.)
,
Prof. Eugenio Villar (eds.)
systemc
uml
simulation
models
modeling
systems
processes
synchronous
module
specification
execution
approach
signal
profile
embedded
cycle
asynchronous
port
events
event
transaction
verification
platform
clock
hetsc
micas
analysis
defined
vhdl
components
input
synchronization
channels
generated
modules
ports
signals
abstraction
standard
generation
library
method
circuits
debugging
architecture
output
specific
asc
features
task
Année:
2008
Langue:
english
Fichier:
PDF, 3.71 MB
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english, 2008
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